通信工程师终端与业务考试培训VHDL语言

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1.5.4 VHDL 语言
VHDL语言是一种用于电路设计的高级语言。它在80年代的后期出现。最初 是由美国国防部开发出来供美军用来提高设计的可靠性和缩减开发周期的一种使 用范围较小的设计语言。由于它在一定程度上满足了当时的设计需求，在1987 年成为ANSI/IEEE的标准（IEEE STD 1076-1987) (87版）。1993年更进一步修订， 变得更加完备，成为ANSI/IEEE的ANSI/IEEE STD 1076-1993标准（93版），VHDL(Very High Speed Integrated Circuit Hardware Descriptiong Language)中文就是超高速集成电路硬件描述语言。它的应用主要是应用在数字电路的设计中。目前，它在我国的应用多数是用在 FPGA/CPLD/EPLD的设计中。当然在一些实力较为雄厚的单位，它也被用来设计 ASICOVHDL语言的特点
(1)允许采用不同的设计方法和描述风格（Top-down,Bottom-up)；
(2)独立于器件的设计，与工艺无关（TechologyIndependent)；
(3)抽象层次多（Behavioral/RTL/Logic)；
(4)易于交流，便于管理，设计资源共享；
(5)促使形成其他标准（WAVES,VITAL, Analog VHDL)。
VHDL语言与其它高级语言区别体现在：VHDL语言的语句很多是并发语句；高 级语言描述的是数字模型（算法）和控制动作、控制行为，而VHDL语言所描述的 是硬件电路的功能；高级语言最终目的是实现希望的控制流，而VHDL语言最终目 的是要造成硬件电路。

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